深圳獵頭公司職位 某軟件開(kāi)發(fā)公司 數(shù)字電路設(shè)計(jì)工程師 20-40萬(wàn)
崗位職責(zé)：
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負(fù)責(zé)下列一個(gè)或多個(gè)方向：
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1. 數(shù)字SOC前端設(shè)計(jì)：根據(jù)市場(chǎng)需求，定義頂層或模塊級(jí)設(shè)計(jì)spec；根據(jù)設(shè)計(jì)spec完成詳細(xì)設(shè)計(jì)文檔；編寫(xiě)HDL代碼；
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2. RTL/布線前/布線后驗(yàn)證，根據(jù)驗(yàn)證需求完成項(xiàng)目的邏輯驗(yàn)證；
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3. 綜合/時(shí)序分析/形式驗(yàn)證；
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4. 生成產(chǎn)品的測(cè)試向量并與測(cè)試工程師完成測(cè)試向量的調(diào)試；
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5. 與系統(tǒng)工程師一起完成FPGA原型或芯片的應(yīng)用級(jí)驗(yàn)證。
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公司介紹：
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新興的企業(yè)產(chǎn)業(yè)集團(tuán)，注冊(cè)資金共計(jì)一億元人民幣，主要涉及通信、電力、和 IT 高科技產(chǎn)業(yè)以及醫(yī)療器械和生物技術(shù)產(chǎn)業(yè)等領(lǐng)域。
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任職要求：
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1.微電子或電路設(shè)計(jì)相關(guān)專(zhuān)業(yè)，本科及以上學(xué)歷，5年及年以上工作經(jīng)驗(yàn)；
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2. 熟悉前端設(shè)計(jì)語(yǔ)言：Verilog；
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3. 至少熟悉一個(gè)設(shè)計(jì)領(lǐng)域（仿真，綜合，時(shí)序分析，形式驗(yàn)證等）；
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4. 熟悉Unix/Linux系統(tǒng)，了解 Perl/Python/Shell語(yǔ)言；
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5. 了解ATPG和測(cè)試向量知識(shí)；
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6. 熟悉FPGA及其相關(guān)工具；
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7. 有MCU相關(guān)經(jīng)驗(yàn)者優(yōu)先；
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8. 良好的溝通能力和團(tuán)隊(duì)合作能力。
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